• RTL顶层代码,IP内部需要IP自己完成连接并保证正确,CM/PLL/MCU/SRAM/TX/RX内部模块不接受外部进行拼接,DFT内部自己处理。IP用到的宏,名称功能文档要说明清楚。优先使用硬核IP。软核需要IP保证质量。不能只提供各个模块,需要外部拼接。
  • 文档,集成设计文档,用户手册,寄存器手册,接口管脚与时序手册,ATE设计手册,SDK手册,TB使用手册。
  • 行为模型,环境变量设置说,宏设置要求说明,testbech,配套的C版本,VCS版本,VERDI版本说明。使用方法,配置流程。

快速仿真办法。

  • SDC需要按照使用的提供最高频率进行。

要提供DC说明,宏说明,环境变量设置。

  • 网表文件。

ATBG

Bsdl

  • lib/db综合器件库,按照当前标准最新的库。不能提供即将过期的工艺库。
  • SOW后2周内提供全部文件资料,SOW前先提供top层接口代码,前端集成开工,不超过2周内提供最终的IP管脚代码。
  • SOW后要进行集成,后端,封装,DFT设计培训讲解。
  • ATE IP TEST方案,JTAG测试脚本,测试用例。
  • SI/PI仿真模型,AMS误码率仿真模型,电源模型,时钟IBIS模型。
  • 每周不少于1次的RD,AE开发问题交流会议,问题多时要增加会议次数。(必须)
  • tapeout后不少于1年的免费服务定位时间。(必须)
  • signoff前不少于1次的check review。(必须)
  • 提供IP设计j集成各领域的checklist。(尽量)

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