使用Tcl脚本分配FPGA管脚
自己主动生成Tcl文件
Project -> Generate Tcl File for Project...
弹出例如以下对话框。设置脚本路径。
编辑引脚
使用set_location_assignment
分配管脚例如以下:
第一次配制时。没有set_location_assignment
语句,自已在set_global_assignment
语句下一行加入就可以。
运行Tcl脚本
Tools -> Tcl Scripts...
选中刚新建的Tcl文件,点击Run执行就可以!
答疑解惑
1. 为什么Tcl中没有为每一个引脚分配输入输出属性。也能保证引脚属性正确?
由于引脚输入输出属性都已经在Verilog语言的module中或原理图中设置了。例如以下图,
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