ISE 中使用system generate
本文讲解简单的ISE中使用system generate,system generate基本使用规则在此不详细说明可以见博客http://blog.csdn.net/xiabodan/article/details/25043779
需要工具
实现-模型
实现-.m文件
function [out1,out2,out3] = simplefunc(dain)
out1 = dain/4;
out2 = dain*8;
out3 = dain+100;
实现-generate HDL代码
实现-ISE工程
实现-ISE testbench 编写
module tb_top; // Inputs
reg clk;
reg ce;
reg [15:0] gateway_in1; // Outputs
wire [18:0] gateway_out;
wire [15:0] gateway_out1;
// Instantiate the Unit Under Test (UUT)
top uut (
.clk(clk),
.ce(ce),
.gateway_in1(gateway_in1),
.gateway_out(gateway_out),
.gateway_out1(gateway_out1)
); initial begin
// Initialize Inputs
clk = 0;
ce = 0;
gateway_in1 = 0; // Wait 100 ns for global reset to finish
#100;
ce =1;
// Add stimulus here end
always #5 clk = ~clk;
always #10 gateway_in1 =gateway_in1 + 1 ;
endmodule
实现-ISE 仿真
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