RK3288 最大输出分辨率为 3840x2160 HDMI 驱动代码位于 kernel/drivers/video/rockchip/hdmi/rockchip-hdmiv2 目录 1.设置默认输出分辨率 网上的资源是修改 kernel/drivers/video/rockchip/hdmi/rockchip-hdmiv2 中的 rockchip-hdmi.h 文件, /* HDMI default vide mode */ #define HDMI_VIDEO_DEFAULT_MODE HD

主要参考的是AM335x的TRM的第8章PRCM模块和13章LCD Controller. 这里在LCD Controller里面的配置描述的比较详细了,分频和像素.消影值的设置等等.不在赘述,很多人都会抱怨说,LCD_PCLK配置只能通过LCD_CLK经过一个分频而来,这样对于频率70~90MHz时配置很困难.但事实上,我们对LCD_CLK的设置,是比较灵活的,参考如下: 8.1.6.10节中:Display PLL Description 左边的部分我会慢慢解释,先看右边.右边的LCD_CL

本文转载自:http://www.javashuo.com/content/p-6398007.html 硬件原理 pmic 电路原理 平台概述 RK808 PWM 介绍 驱动分析 dts 驱动流程 PMIC PWM 配置相关 menuconfig 修改各路 DCDC 和 LDO 方法一修改dts 方法二运行中动态设置 设置 DCDC 工作模式接口 方法一初始化设置 方法二运行下切换 调试流程与碰到的问题 调试环境 RK3288 Android5.1 硬件原理 pmic 电路原理 电源分为两种:

Ⅰ.概述 对于系统时钟应该都知道它的作用,就是驱动整个芯片工作的心脏,如果没有了它,就等于人没有了心跳. 对于使用开发板学习的朋友来说,RCC系统时钟这一块知识估计没怎么去配置过,原因在于开发板提供的晶振基本上都是官方标准的时钟频率,使用官方的标准库,这样系统时钟就是默认的配置,也就是默认的频率.但对于自己设计开发板,或者想要改变系统时钟频率(如:降低功耗就需要降频)的朋友来说,配置系统时钟就有必要了. 关于时钟这一块对定时器(TIM.RTC.WDG等)相关的外设也比较重要,因为要求精准,就需要

PLL复位通常犯的错误 或者是像上一篇文章 FPGA知识大梳理(四)FPGA中的复位系统大汇总  中的图一样,也是错误设计.为何呢?看ALTPLL (Phase-Locked Loop) IP Core User Guide这个官方手册就够了.直接看图     坑爹啊,locked输出高电平,居然是抖动的.所以不能直接使用这个信号作为系统复位信号. ​ 所谓群众的眼睛是雪亮的啊,大家此时一定对Gate lock一见钟情,可惜Gate lock这个信号不是所有器件都支持的.具体如下 如果器件支持的

第15章     RCC—使用HSE/HSI配置时钟 全套200集视频教程和1000页PDF教程请到秉火论坛下载:www.firebbs.cn 野火视频教程优酷观看网址:http://i.youku.com/firege 本章参考资料:<STM32F4xx中文参考手册>RCC章节. 学习本章时,配合<STM32F4xx中文参考手册>RCC章节一起阅读,效果会更佳,特别是涉及到寄存器说明的部分. RCC :reset clock control  复位和时钟控制器.本章我们主要讲解时

本章参考资料:< STM32F4xx 中文参考手册> RCC 章节.学习本章时,配合< STM32F4xx 中文参考手册> RCC 章节一起阅读,效果会更佳,特别是涉及到寄存器说明的部分.RCC : reset clock control 复位和时钟控制器.本章我们主要讲解时钟部分,特别是要着重理解时钟树,理解了时钟树, F429 的一切时钟的来龙去脉都会了如指掌. HSE时钟 HSE:High Speed External Clock signal,即高速的外部时钟.来源:有源晶

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/** ****************************************************************************** * @author    Maoxiao Hu * @version   V1.0.0 * @date       Jan-2015 ****************************************************************************** * < COPYRIGHT 2015 IS

从自己的板子STM32F407入手,参考官方的SystemInit()函数: 核心在SetSysClock()这个函数,官方默认是采用HSE(设定为8MHz)作为PLL锁相环的输入输出168MHz的SYSCLK: /** * @brief Setup the microcontroller system * Initialize the Embedded Flash Interface, the PLL and update the * SystemFrequency variable. * @

原地址:http://fangjian0518.blog.163.com/blog/static/559196562011210103455430/  PLL的作用? 答:LPC2000系列ARM内部都在PLL电路,将振荡器产生的时钟频率Fosc通过PLL升频,就可以获取更高的系统时钟(Fcclk),并且它 为整个系统及所有部件提供时钟.     PLL的工作原理? 答:1.由Fosc振荡器输入一个时钟信号: 2.经过相位频率检测,检测两路输入信号的相位频率,并根据差值,输出不同大小的电流信号:

原地址:http://blog.sina.com.cn/s/blog_4419d72d0100mu7h.html LPC2214的PLL与定时器设置 http://www.dpj365.cn/bbs/viewthread.php?tid=895&extra=page=1 1.振荡源选择:LPC2214的振荡器可工作在两种模式:从属模式和振荡模式.从属模式下,外部时钟源信号从XTAL1脚输入,XTAL2管脚不连接.时钟源的频率限制在1MHz-50MHz.振荡模式下,XTAL1和XTAL2外接晶振.

layout: post tags: [STM32] comments: true 文章目录 layout: post tags: [STM32] comments: true 为什么要了解时钟树? 树的根 标准库的时钟配置 外部时钟源16M SetSysClockTo72 patch 其他细节 为什么要了解时钟树? 最近项目开发的时候,外部时钟源是16MHz,结果配置错了系统时钟,STM32F103的系统时钟频率最高为72MHz,错误地配置到了144MHz,但是AHB总线时钟又正确地配置到72

http://www.cnblogs.com/firege/p/5806121.html  (驱动大神) http://blog.csdn.net/yanbixing123/article/details/52299519 ov5640作为外接摄像头设备,通过i2c与主板通信 先介绍一下摄像头相关的术语 : 黑电平校正 : 去除暗电流导致的噪声: 镜头校正    : 校正镜头导致的光强畸变 : 坏点校正   : 掩盖静态和动态坏点 降噪          : 去除各种采集过程导致噪声 颜色校正 

一.C5509时钟发生器的两个功能 1.将从CLKIN引脚输入的时钟信号变换为适当频率的CPU时钟,提供给CPU.外设和其他模块使用: 2.将CPU时钟通过可编程分频器输出到CLKOUT引脚. 时钟发生器内部有数字锁相环PLL(phase lock ring)和时钟模式寄存器(CLKMD). 二.时钟发生器的工作模式 1.旁路模式Bypass Mode 时钟模式寄存器CLKMD中的PLL ENABLE位为0,此时锁相环(PLL)被禁用,输出时钟信号频率为输入时钟信号频率的一分频.二分频或者四分频

填空 1指令含义 列出文件列表的ls命令 切换目录的cd命令 创建目录的mkdir命令 删除目录的rmdir命令 复制文件的cp命令 删除文件或目录的rm命令 让显示画面暂停的more命令 连接文件的cat命令 移动或更换文件,目录名称的mv命令 显示当前所在目录的pwd命令 2 做移植操作系统的三步:下载bootloader,下载内核,下载文件 3 ARM7TDMI各个字母的含义:支持32位寻址范围,并弥补了ARM6不能在低于5V电源电压下工作的不足 考点: 1.       vi编辑器模式

Chipscope 仿真VmodCAM IIC程序: 目的:熟悉EDK中建立chipscope 注意:zedboard使用digilent USB下载时,chipscope不能和SDK同时使用,否则芯片会死机.要用仿真器烧写程序. 1:搭建硬件平台   硬件平台如下所示:具体的EDK设计流程参见XILINX大学workshop                                       http://china.xilinx.com/support/university/prof

S3C2440中有三种时钟,分别是FCLK,HCLK和PCLK.这三种时钟的功能各不相同,其中FCLK主要是为ARM920T的内核提供工作频率,如图: HCLK主要是为S3C2440 AHB总线(Advanced High performance Bus)上挂接硬件提供工作频率,AHB总线主要挂接有内存,NAND,LCD控制器等硬件,如图: PCLK主要是为APB总线提供频率,APB总线上主要挂载UART.WatchDog等硬件控制器,如图: S3C2440上的时钟源是12MHz,如果想让CPU

一.对clock的基本认识 1 s3c2410的clock & power management模块包含三个部分:clock control.usb control.power control.现在的关注点是clock control.     2.s3c2410有两个pll(phase locked loop,锁相环,在高频中学过,可以实现倍频,s3c2410的高频就是由此电路产生的).其中一个是MPLL,M即为main,用来产生三种时钟信号:Fclk(给CPU核供给时钟信号,我们所说的s3c

转用MDK有一段时间了,越来越觉得MDK的强大,因为我之前都是用ADS1.2开发产品,所以更能体会到MDK的强大与易用性.MDK编译出来的代码与ADS1.2相比,代码量减少了很多,我的一个工程用ADS1.2编译为25.4KB(都是bin格式),但用MDK编译出来仅有19.5KB(采用默认优化级别,即L2优化级别).根据我个人的经验,使用一个新的编译器,难点往往有三个,一个是建立一个新的工程,以及工程项目的配置:二是启动代码的编写:三是如何下载和单步调试.今天重点写一下MDK的启动代码.使用MDK