本文是记录项目过程中遇到的奇巧淫技,如有遗漏或者不足,请大家改正和补充,谢谢. 随着深亚微米技术的普及与发展,leakage功耗在整个功耗中的比重越来越大,比如45nm下,已经占到了60%以上,所以低功耗解决方案应运而生.目前已经有一套标准的低功耗设计流程,流程有CPF(cadence主导)和UPF(synopsys主导)两种,但技术趋势是UPF会大一统,所以本篇将为那些仍旧使用ncverilog而不是vcs仿真工具的苦逼们提供一些参考.目前常用的降低低功耗的方法有四种:多电压域.时钟门控.电源

对于48pin脚的CC1310而言,属于电源类的管脚如下: 上述电源类管脚的关系如下: 1 VDDS类管脚 VDDS类管脚包括VDDS.VDDS2.VDDS3和VDDS_DCDC四个管脚.其中VDDS为电压调节器.掉电检测.全局LDO和部分IO供电,VDDS2和VDDS3为剩余IO供电,VDDS_DCDC为内部DC/DC供电.典型电压范围为1.8V~3.8V. VDDS类管脚是唯一需要使用者外部供电的电源.因此,对于使用者而言,只需为VDDS类管脚提供合适的电源就可使CC1310正常工作. 2

在一个嵌入式系统中使用最多的莫过于 通用输入输出 GPIO口.看到论坛中经常有朋友问海思为什么没有提供GPIO驱动.其实不然. 在海思SDK  xxx/osdrv/tools/board_tools/reg-tools-1.0.0/source/tools/下 提供了himm的读写工具源码.你也可以根据himm的源码来写一个文件设备操作的驱动.毕竟轮子已经有了,我们就没必要再去造轮子了. 这个工具是用来 配置海思寄存器的.当然可以稍加改造或者在应用直接使用来控制通用寄存器. 根据海思提供资料 ,

原文地址:https://mp.weixin.qq.com/s/0dAyTpAcQWXlYULqCeKgFA 每个集成电路(IC)都必须使用电容将各电源引脚连接到器件上的地,原因有二:防止噪声影响其本身的性能,以及防止它传输噪声而影响其它电路的性能. 电力线就像天线一样,可能会拾取其它地方的高频(HF)噪声,然后通过电场.磁场.电磁场和直接传导等方式耦合到系统中.电源端的高频噪声会影响许多电路的性能,因此,必须将IC电源上存在的任何高频噪声短接到地.为实现噪声短接,我们不能使用导体,因为它会造成

一.DDR电源简介 1. 电源 DDR的电源可以分为三类: a.主电源VDD和VDDQ,主电源的要求是VDDQ=VDD,VDDQ是给IO buffer供电的电源,VDD是给但是一般的使用中都是把VDDQ和VDD合成一个电源使用. 有的芯片还有VDDL,是给DLL供电的,也和VDD使用同一电源即可.电源设计时,需要考虑电压,电流是否满足要求,电源的上电顺序和电源的上电时间,单调性等.电源电压的要求一般在±5%以内.电流需要根据使用的不同芯片,及芯片个数等进行计算.由于DDR的电流一般都比较大,所以

原文地址 本文内容 为什么需要一个 Android 模拟器 针对 Visual Studio Android 模拟器的调试 Visual Studio Android 模拟器的传感器模拟和其他功能 A peek under the covers 当前的限制 北京时间今天(2014年11月12日)凌晨--.NET 开源--集成 Clang 和 LLVM,并且自带 Android 模拟器,这意味着 Visual Studio 这个当下最好没有之一的 IDE 正式支持编写 Android 和 iOS

用户I/O:不用解释了.   配置管脚: MSEL[1:0] 用于选择配置模式,比如AS.PS等. DATA0 FPGA串行数据输入,连接到配置器件的串行数据输出管脚. DCLK FPGA串行时钟输出,为配置器件提供串行时钟. nCSO(I/O)FPGA片选信号输出,连接到配置器件的nCS管脚. ASDO(I/O)FPGA串行数据输出,连接到配置器件的ASDI管脚. nCEO 下载链期间始能输出.在一条下载链中,当第一个器件配置完成后,此信号将始能下一个器件开始进行配置.下载链上最后一个器件的n

管脚是FPGA重要的资源之一,FPGA的管脚分别包括,电源管脚,普通I/O,配置管脚,时钟专用输入管脚GCLK等. 本文引用地址:http://www.eepw.com.cn/article/266429.htm (1)电源管脚: 通常来说: FPGA内部的电压包括内核电压和I/O电压. 1.内核电压:即FPGA内部逻辑的供电.通常会较I/O电压较低,随着FPGA的工艺的进度,FPGA的内核电压逐渐下降,这也是降低功耗的大势所趋. 2.I/O电压 (Bank的参考电压).每个BANK都会有独立的

Q1:我自己做了一块MSP430F149的试验板,以前用下载线进行调试没有出现过问题,但是,最近我每次make后用下载线调试时,总是弹出一个窗口,给我提示:Could not find target status. 然后就死到那儿了,请问这是什么问题呢?A1:检查Jtag口线是否连接正常,如果JTAG口线连接正常,可能是供电不足,目标板加电再测试. Q2:我用的430f22x学习套件,请问在IAR Embedded Workbench 中仿真时如何看程序运行时间.A2:只有软件模拟下可以看, V

1.如何选择PCB 板材? 选择PCB 板材必须在满足设计需求和可量产性及成本中间取得平衡点.设计需求包含电气和机构这两部分.通常在设计非常高速的 PCB 板子(大于 GHz 的频率)时这材质问题会比较重要. 例如,现在常用的 FR-4 材质,在几个GHz 的频率时的介质损耗(dielectric loss)会对信号衰减有很大的影响,可能就不合用.就电气而言,要注意介电常数(dielectric constant)和介质损在所设计的频率是否合用. 2.如何避免高频干扰? 避免高频干扰的基本思路是

转自 http://www.fairchildic.org/module/forum/thread-658-1-1.html (原帖包括详细的附件内容) 1. 电源 DDR的电源可以分为三类A.主电源VDD和VDDQ,主电源的要求是VDDQ=VDD,VDDQ是给IO buffer供电的电源,VDD是给但是一般的使用中都是把VDDQ和VDD合成一个电源使用.有的芯片还有VDDL,是给DLL供电的,也和VDD使用同一电源即可.电源设计时,需要考虑电压,电流是否满足要求,电源的上电顺序和电源的上电时间

14.反馈与触发器 振荡器不需要人的干涉即可自主且不断地实现断开和闭合.所有计算机都靠某种振荡器来使其他部件同步工作. 当两个开关都断开时,电路有两个稳定状态,这样的一个电路称为触发器.触发器具有记忆性,可以保持信息.各种触发器如下表: <code>书中常用的电路 振荡器 分频器 8位行波(异步)计数器 8-1选择器 3-8译码器 15.字节与十六进制 看完这一章,个人认为十六进制的出现应该就是为了要简单清晰的表示字节吧.四进制表示就只比二进制缩短了1倍,八进制实现不了8个位组成的字节,二百五

PCB优化设计(二) 2011-04-25 11:41:05|  分类: PCB设计   目 前SMT技术已经非常成熟,并在电子产品上广泛应用,因此,电子产品设计师有必要了解SMT技术的常识和可制造性设计(DFM)的要求.采用SMT工艺的 产品,在设计之初就应综合考虑生产工艺流程.原材料的选择.设备的要求.器件的布局.测试条件等要素,尽量缩短设计时间,保证设计到制造的一次性成功. 3.5 元器件布局设计 元器件的布局是按照原理图的要求和元器件的封装,将元器件整齐.美观的排列在PCB上,满足工艺性

1 PCB布线与布局 PCB布线与布局隔离准则:强弱电流隔离.大小电压隔离,高低频率隔离.输入输出隔离.数字模拟隔离.输en入输出隔离,分界标准为相差一个数量级.隔离方法包括:空间远离.地线隔开. 2 PCB布线与布局 晶振要尽量靠近IC,且布线要较粗 3 PCB布线与布局 晶振外壳接地 4 PCB布线与布局 时钟布线经连接器输出时,连接器上的插针要在时钟线插针周围布满接地插针 5 PCB布线与布局 让模拟和数字电路分别拥有自己的电源和地线通路,在可能的情况下,应尽量加宽这两部分电路的电源与地线

转载自http://www.cnblogs.com/thjfk/p/4086001.html camera基本代码架构 Camera原理:外部光线穿过lens后,经过color filter滤波后照射到sensor面上,sensor将从lens上传到过来的光线转换成电信号,再通过内部的AD转换为数字信号,如果sensor没有集成DSP,则通过DVP的方式传输到baseband,此时的数据格式是RAW DATA.必须通过平台的isp来处理.如果集成了DSP,这RAW DATA数据经过AWB,col

美睿视讯 为蜂鸟A20准备的 MerriiLinux 功能非常简陋.所以能用上主流的 debian 或者 LUbuntu 就可以说是非常迫切的需求了.蜂鸟A20(Merrii Hummingbird A20)从硬件配置上来说非常接近 cubietruck ,相同的全志A20,相同的千兆PHY 芯片 RT8211E ,相同的wifi Bluetooth芯片 AP6210.但内存和闪存比 cubietruck 要小.   准备工作: 1.编译蜂鸟专用 uboot (主要是为了激活网卡.如果不想编译u

一.HDL的概念和特征 HDL,Hard Discrimination Language的缩写,翻译过来就是硬件描述语言.那么什么是硬件描述语言呢?为什么不叫硬件设计语言呢?硬件描述语言,顾名思义就是描述硬件的语言,它用文本的形式来描述电子系统硬件结构和行为,是一种用形式化方法来描述数字电路和系统的语言.正是因为如此,硬件与软件不一样,他不像软件,你某天突发奇想,想实现某个的界面,搞搞代码就OK了.硬件它是由实实在在的物理器件搭载而成,用抽象的语言怎么可能弄出一个电路来呢? 一门语言,总有那么一

对于所有的处理器,pad 一般可以分为两大类:IO(输入输出).Power(VDD 和GDD).类似摄像头 IO.以太网 IO.PWM 的 IO 等等,都可以统称为 IO.一个 IO,有可能能够被配置为多种功能.GPIO 是 IO 的一种,GPIO 就是普通输入输出的意思,当需要实现高低电平输入输出.中断功能的时候,都需要将其设置为 GPIO 模式.本文档以 GPIO 为例,介绍如何配置 iTOP-4418 和 iTOP-6818 的 IO.iTOP-4418 和iTOP-6818 的完全兼容,

这一章我们来实现第一个FPGA工程-LED流水灯.我们将通过流水灯例程向大家介绍一次完整的FPGA开发流程,从新建工程,代码设计,综合实现,管脚约束,下载FPGA程序.掌握本章内容,大家就算正式的开始入门FPGA开发了. 1.1.1.电路说明 1.1.2.新建工程 第一步:从开始菜单启动Quartus II 13.1(64 bit) ,如下图. 第二步:菜单栏选择File->New Project Wizard,新建工程. 第三步:弹出新建工程对话框,点击Next,下一步. 第三步:如下图,依次

这一章我们来实现第一个FPGA工程—LED流水灯.我们将通过流水灯例程向大家介绍一次完整的FPGA开发流程,从新建工程,代码设计,综合实现,管脚约束,下载FPGA程序.掌握本章内容,大家就算正式的开始入门FPGA开发了. 1.1.1.电路说明 1.1.2.新建工程 第一步:从开始菜单启动Quartus II 13.1(64 bit) ,如下图. 第二步:菜单栏选择File—>New Project Wizard,新建工程. 第三步:弹出新建工程对话框,点击Next,下一步. 第三步:如下图,依次

这些日子一直在设计自己的Cyclone V SoC开发板,由于我们这种散兵游勇,是断然没有厂家和代理技术支持的,因此只能找各种现成方案参考.其实Cyclone V SoC芯片的外围电路设计不难,无非就是DDR3.千兆以太网PHY.USB PHY.USB转串口.但是除了这些功能电路外,更重要的应该是电源电路了.以DE0-Nano-SoC为参考,一个板子上,总共涉及到了5V.9V.3.3V.1.1V.1.2V.1.5V.1.8V.2.5V.以及DDR的VTT和VREF这10种电压.吓死个人哦.一直都