【1】输入端口不能使用reg数据类型，因为reg类型对应的FPGA内部的寄存器。这样理解：reg寄存器具有记忆功能;而wire类型数据就相当于一根连线。input输入信号用wire连线进来就好；output输出信号可以用wire连线输出，同时也可以用reg寄存器直接输出（此时相当于寄存器输出端延长了，而延长的那一段其实还是一段连线而已）

【2】管脚分配文件的编写

NET "led[0]"  LOC=P17　　|  IOSTANDARD =LVCMOS33；

问题：后半句啥意思 不懂！！！

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