格雷码(Gray code)仿真

作者：桂。

时间：2018-05-12  16:25:02

链接：http://www.cnblogs.com/xingshansi/p/9029081.html

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前言

FIFO中的计数用的是格雷码，简要记录格雷码的分析思路。

一、格雷码与8421码对应关系

通过真值表分析，可以得出：

即格雷码是：8421码从最右边起，依次与左边一位异或，最左边一位不变，对应实现语言：

GrayCount_out <= {BinaryCount[COUNTER_WIDTH-],BinaryCount[COUNTER_WIDTH-:] ^ BinaryCount[COUNTER_WIDTH-:]};

另外：

二、仿真实现

Graycounter.v：

`timescale 1ns/1ps

module GrayCounter(Enable_in, Clear_in, Clk, GrayCount_out);
parameter   COUNTER_WIDTH = ;

output reg  [COUNTER_WIDTH-:]    GrayCount_out;  //'Gray' code count output.

input wire  Enable_in;  //Count enable.
input wire  Clear_in;   //Count reset.
input wire  Clk;

/////////Internal connections & variables///////
reg    [COUNTER_WIDTH-:]         BinaryCount;

/////////Code///////////////////////

always @ (posedge Clk)
begin
    if (Clear_in) begin
        BinaryCount   <= {COUNTER_WIDTH{'b 0}} + 1;  //Gray count begins @ '' with
        GrayCount_out <= {COUNTER_WIDTH{'b 0}};      // first 'Enable_in'.
    end
    else if (Enable_in) begin
        BinaryCount   <= BinaryCount + ;
        GrayCount_out <= {BinaryCount[COUNTER_WIDTH-],
                          BinaryCount[COUNTER_WIDTH-:] ^ BinaryCount[COUNTER_WIDTH-:]};
    end
end

endmodule

testbench：

`timescale 1ns / 1ps
module graycounter_tb;
parameter   COUNTER_WIDTH = ;

logic clk,rst;
logic clr,en;
logic [COUNTER_WIDTH-:]    GrayCount_out;
initial
begin
clk = ;
rst = ;
#
rst = ;
clr <= ;
en <= ;
#
clr <= ;
en <= ;
#
$stop;
end

logic [:] counter;

always # clk = ~clk;

always @(posedge clk)
begin
    if(rst | clr)
    begin
        counter <= ;
        clr <= ;
        en <= ;
    end
    else
    begin
        counter <= counter + 'b1;
    end
end
//main
GrayCounter gray_inst(
.Enable_in(en),
.Clear_in(clr),
.Clk(clk),
.GrayCount_out(GrayCount_out)
);

endmodule

电路图看出：

主要是LUT、D触发器、DS触发器，原语实现也较为方便。