本实验设计的VGA显示驱动完全基于FPGA实现，用SDRAM做缓存设备，通过ARM控制VGA显示的内容。ARM

通过FSMC总线向FPGA发送数据，由于总线的速度和VGA的显示速度与SDRAM的读写速度不匹配，所以在数据进入

SDRAM前和数据输出SDRAM后需要分别添加FIFO模块和RAM模块做缓存，数据经过SDRAM缓存后，最终输出到

VGA显示器上。

实验指导书及代码包下载：

http://pan.baidu.com/s/1midJhs0

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